Руководство: Делаем алгоритм шифрования AES на Verilog

Читателю предлагается пошаговое руководство реализации алгоритма AES - 128 для FPGA/ASIC с использованием языка Verilog.
Руководство состоит из двух частей: предыстория и работа алгоритма AES и реализация AES с использованием Verilog.
