Выберите категорию
|
Вебинар
[147]
Вебинары по FPGA и языкам проектирования для ПЛИС
|
|
Заметка
[56]
Небольшие заметки по использованию технологии FPGA/ПЛИС
|
| Руководство [53] |
|
Мероприятия
[31]
Семинары, конференции, встречи
|
|
Анонсы
[15]
Свежие новости и релизы из мира FPGA
|
|
Новинки
[55]
Новые изделия на базе FPGA
|
| Стрим [4] |
Объявления
Случайные статьи
Есть мнение
InnovateFPGA: как конъюнктура и следование ложным трендам угробили один из лучших конкурсов по разработке на ПЛИС
Подробнее
High Level Synthesis
Разработка IP-блока с помощью инструментов высокоуровнего синтеза: HLS Часть 3
Подробнее
High Level Synthesis
Основы AXI часть 7 - Подключение к PS с помощью AXI4-Lite и Vitis HLS
Подробнее
Статистика
Архив новостей из мира FPGA
интервью с Н.А.Шелепиным «О сегодняшнем развитии технологий и компонентов микро- и наноэлектроники»
О сегодняшнем развитии технологий и компонентов микро- и наноэлектроники мы поговорили с д.т.н., проф. Н.А. Шелепиным. Николай Алексеевич является модератором Секции №4 на российском форуме «Микроэлектроника 2021», и как никто другой знаком с научно-исследовательской работой по тематике микро- и наноэлектроники и положением дел в отрасли.
...
Читать дальше »
466 
PY-UVM
Ну что ж, медленно, но верно оно все-таки случилось. Python добрался и до UVM. Встречайте уже второй релиз PY-UVM 2.0 Информация по теме: ... Читать дальше »
516 
0 
Интервью с генеральным директором АО «НИИМА «Прогресс»
В преддверии Форума «Микроэлектроника-2021» — главного события для отечественных разработчиков микроэлектронных компонентов, генеральный директор АО «НИИМА «Прогресс» Захар Константинович Кондрашов рассказал про ситуацию и последние тенденции в отрасли. ... Читать дальше »
591
0 
Идеи проектов для FPGA
Возможно, готовые списки проектов смогут помочь! 
Ускорение масштабирования изображений с помощью CNN на FPGA
Процесс создания изображений с высоким разрешением из изображения с низким разрешением требует идентификации недостающих пикселей. Заполнение “пиксельных пустот” возможно устранить с помощью различных методов машинного обучения. Из всего многообразия методов сверточные нейронные сети выделяются свое ... Читать дальше »
412
0 
Verismith: поиск багов в синтезаторах для FPGA
Любопытная статья 2020 года о поиске багов в синтезаторах логики с помощью инструмента с открытым кодом. Инструмент, разработанный авторами (Yann Herklotz, John Wickerson), генерирует случайный модуль на Verilog. Результат синтеза случайного модуля сверяется с исходным RTL. Авторы использовали свою разработку, чтобы ... Читать дальше »
345
0 
6 Способов расширения функциональности вашей отладочной платы с ПЛИС
Если вы когда-нибудь задумаете сделать свою отладочную плату бюджетного ценового диапазона, то вам наверняка будет полезно знать про общепринятые стандартные интерфейсы подключения внешней периферии: датчиков, камер, дисплеев и тд. В этой заметке вы ... Читать дальше »
485
0 
Разработка систем SDR с использованием Aldec HES
По мере развития телекоммуникационных технологий наблюдается постоянно растущая тенденция к разработке высокопроизводительных систем радиосвязи. Программно-определяемое радио (SDR) является ярким примером. Значительную часть цифровой обработки сигналов стало возможно выполнять на пр ... Читать дальше »
905
0 
Мега проект - 100 RISC-V ядер в FPGA
Отличный проект, в котором есть и безумие и практика. Ânderson Ignacio da Silva в своем блоге написал небольшой обзор того, как он сумел заимплементить сеть-кристалле из 100 объединённых RISC-V ядер. Как пишет сам Ânderson: ... Читать дальше »
674
0 
Решаем судоку на SystemVerilog
Наткнулся на пару любопытных заметок по не совсем традиционному использованию SystemVerilog. Автор сделал две заметки (раз и ... Читать дальше »
677
0 |
0