Выберите категорию
|
Вебинар
[158]
Вебинары по FPGA и языкам проектирования для ПЛИС
|
|
Заметка
[58]
Небольшие заметки по использованию технологии FPGA/ПЛИС
|
| Руководство [53] |
|
Мероприятия
[36]
Семинары, конференции, встречи
|
|
Анонсы
[19]
Свежие новости и релизы из мира FPGA
|
|
Новинки
[63]
Новые изделия на базе FPGA
|
| Стрим [5] |
Объявления
Случайные статьи
Верификация
Верификация проблем с пересечением тактовых сигналов в ПЛИС с помощью ALINT-PRO
Подробнее
Статистика
Архив новостей из мира FPGA
Модельное проектирование ПЛИС и ASIC в контексте функциональной безопасности
Помимо ASIC, FPGA и SoC играют все большую роль во все большем числе систем и приложений благодаря своим уникальным свойствам: гибкости, высокой пропускной способности, низкой задержке и производительности на ватт. ... Читать дальше » 
2339 
Глубокое обучение на FPGA
Машинное обучение и глубокое обучение повсюду: новые алгоритмы, новые приложения, новые платформы и новые движки. В этом вебинаре мы рассмотрим глубокое обучение с особым акцентом на использование ПЛИС в качестве механизмов вывода для сверточных нейронных сетей. Вы узнаете: ... Читать дальше »
2555 
1 
Вебинар: Верификация с использованием OSVVM
Джим Льюис совместо с Aldec приглашает на вебинар по OSVVM. На нем расскажут про верификацию и продемонстрируют основу верификации - транзакции. Мероприятие пройдет 10 декабря. Подробнее: https://www.al ... Читать дальше »
963
0 
«Временные ограничения и анализ в Vivado» – совместный вебинар Макро Групп и PLC2, авторизованного тренинг-партнёра Xilinx
Компания Макро Групп начинает сотрудничество в области обучения технологиям Xilinx с компанией PLC2 GmbH (Германия), авторизованным тренинг-партнёром (ATP) Xilinx. Подготовленные PLC2 тренинги и учебные курсы становятся доступны на территории России и СНГ и проводятся совместными усилиями обеих компаний.
1305
0 
Ускорения отладки RTL для ПЛИС
Отладка проекта занимает значительную часть времени любого разработчика ПЛИС, и в этой области можно сделать многое для повышения индивидуальной и командной производительности. ... Читать дальше »
1253
0 
Новые возможности VHDL2019
Язык описания аппаратуры “VHDL” получил два основных обновления в декабре 2019 года. Ассоциация стандартов IEEE выпустила последнюю версию VHDL с большим количеством новых функций. Язык подвергся небольшой "чистке", получил новые API для работы с датами, файлами или каталогами, а такж ... Читать дальше »
1339
1 
Вебинар: Accelerating Data Channels to 112 Gbps PAM4: A Case Study in Real-World FPGA Implementation
Вебинар с представителями фирм Achronix и Samtec посвящен реализации 112Gbps PAM4 с ипользованием чипа Achronix Speedster®7t. На вебинаре расскажут:
Реализация глубоких нейронных сетей на ПЛИС
Разработка приложений для глубокого обучения, компьютерного зрения, обработки сигналов и их развертывание на ПЛИС, графических процессорах или таких платформах, как Xilinx Zynq™, NVIDIA® Jetson или ARM®, является сложной задачей из-за ограничений ресурсов, присущих встроенным устройствам. В про ... Читать дальше »
1581
0 
Преодоление энергетических, габаритных и других конструктивных ограничений с помощью возможностей Плис
Вебинар компании Lattice Описание: Технологические тенденции, такие как промышленная автоматизация и 5G, заставляют разработчиков на разных рынках стремиться добавить обработку и подключение к приложениям, работающим на в направлении network Edge. ... Читать дальше »
904
0 
Написание структурированных тестбенчей на VHDL
Разработчики часто говорят о повторном использовании своих нароботок в новых проектах Учитывая, что написание testbench может быть таким же, если не большим, усилием, чем создание непосредственно самого проекта, повторное использование testbench так же важно. Структурированный тестбенч позволяет разработат ... Читать дальше »
1609
0 |
0